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TMS320C6415-5E0 IC产品资料

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TMS320C6415-5E0 IC产品资料
资料编号:
383702
资料标题:
TMS320C6415-5E0
品 牌:
TI
点击次数:
197
文件大小:
2232
资料属性:
....

TMS320C6415-5E0 资料标题简介

Highest-Performance Fixed-Point Digital

TMS320C6415-5E0 资料关键信息

Highest-Performance Fixed-Point Digital
Signal Processors (DSPs)
− 2-, 1.67-, 1.39-ns Instruction Cycle Time
− 500-, 600-, 720-MHz Clock Rate
− Eight 32-Bit Instructions/Cycle
− Twenty-Eight Operations/Cycle
− 4000, 4800, 5760 MIPS
− Fully Software-Compatible With C62x™
− C6414/15/16 Devices Pin-Compatible
 VelociTI.2™ Extensions to VelociTI™
Advanced Very-Long-Instruction-Word
(VLIW) TMS320C64x™ DSP Core
− Eight Highly Independent Functional
Units With VelociTI.2™ Extensions:
− Six ALUs (32-/40-Bit), Each Supports
Single 32-Bit, Dual 16-Bit, or Quad
8-Bit Arithmetic per Clock Cycle
− Two Multipliers Support
Four 16 x 16-Bit Multiplies
(32-Bit Results) per Clock Cycle or
Eight 8 x 8-Bit Multiplies
(16-Bit Results) per Clock Cycle
− Non-Aligned Load-Store Architecture
− 64 32-Bit General-Purpose Registers
− Instruction Packing Reduces Code Size
− All Instructions Conditional
 Instruction Set Features
− Byte-Addressable (8-/16-/32-/64-Bit Data)
− 8-Bit Overflow Protection
− Bit-Field Extract, Set, Clear
− Normalization, Saturation, Bit-Counting
− VelociTI.2™ Increased Orthogonality
 Viterbi Decoder Coprocessor (VCP) [C6416]
− Supports Over 600 7.95-Kbps AMR
− Programmable Code Parameters
 Turbo Decoder Coprocessor (TCP) [C6416]
− Supports up to 7 2-Mbps or
43 384-Kbps 3GPP (6 Iterations)
− Programmable Turbo Code and
Decoding Parameters

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联系方式

联系时间:每周一至周五
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